Este é o melhor microcontrolador (microprocessador), um RISCQUIZINHO que roda com 50Hz....
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TCPIPCHIP
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M++
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por Iran » 05 Mar 2010 11:15
Para testar o funcionamento da UCP, 12 exemplos foram criados e
testados. Alguns bugs foram detectados, mas corrigidos na memória de
controle. Acreditamos que a UCP não tenha mais BUGs na execução dos
programas, gostaríamos que vocês leitores interessados, ajude-nos a achá-los
testando os seus próprios programas.
Os links na página nao funcionan.
OPS !!! FUNCIONAM SIM EU É QUE FIZ BESTEIRA
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por fabim » 05 Mar 2010 11:42
Marcelo Samsoniuk escreveu:bem bacana... ele fez em esquemático mesmo ou vhdl/verilog?
Nem vem..!!
Num vai falar mal do processador não é ? á tá loco.
Um simulador muito bom pra montar estes processadores e que tem uma **** velocidade de execução, é o EWB32...
Este eu uso até hoje para RF, filtros, circuitos digitais muito complexos..
Mano, ve só.
Sou responsável pelo que escrevo!!! E não pelo que você entende !!!
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por tcpipchip » 05 Mar 2010 13:28
A idéia é portar para VHDL (Lattice) um dia...mas no momento estamos criando mais instruções...o pessoal pediu ROL e ROR 
Anexo a UCP vista internamente...nivel 1 de ZOOM
Anexo a UCP vista internamente...nivel 1 de ZOOM
Editado pela última vez por tcpipchip em 05 Mar 2010 15:06, em um total de 1 vez.
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por msamsoniuk » 05 Mar 2010 15:45
realmente eh um **** trampo puxar linha por linha!
estes dias eu consegui fazer um teste legal: receber e enviar sequencias sincronizadas de dados atraves de pipes no icarus verilog, conectando assim a simulacao do circuito digital com programas que simulam interfaces de entrada e saida.
rodando em um core2 duo de 2.1GHz eu consegui rodar a simulacao do circuito digital simples com um clock de 90KHz em cada core!
para desenvolver eu prefiro o ISE da xilinx... a sintese dele dah boas dicas de otimizacao e ajuda a eliminar praticas ruins. eh facil simular e tambem tem um visualizador de esquematico rtl que permite ver e corrigir muitas bobeiras no codigo.
porem o ISE nao faz simulacoes longas e nao permite interface facil com outros programas externos.
estes dias eu consegui fazer um teste legal: receber e enviar sequencias sincronizadas de dados atraves de pipes no icarus verilog, conectando assim a simulacao do circuito digital com programas que simulam interfaces de entrada e saida.
rodando em um core2 duo de 2.1GHz eu consegui rodar a simulacao do circuito digital simples com um clock de 90KHz em cada core!
para desenvolver eu prefiro o ISE da xilinx... a sintese dele dah boas dicas de otimizacao e ajuda a eliminar praticas ruins. eh facil simular e tambem tem um visualizador de esquematico rtl que permite ver e corrigir muitas bobeiras no codigo.
porem o ISE nao faz simulacoes longas e nao permite interface facil com outros programas externos.
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por pbernardi » 05 Mar 2010 19:00
Se não me engano, saiu na Elektor uma matéria sobre esse M++.
Como conceito era interessante. Mas tinha pinos de I e pinos de O separados, daí ficava F***.
Mas de qualquer maneira, é um trabalho muito bem feito.
Como conceito era interessante. Mas tinha pinos de I e pinos de O separados, daí ficava F***.
Mas de qualquer maneira, é um trabalho muito bem feito.
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